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          先進IC設計技術培訓班
   入學要求

        學員學習本課程應具備下列基礎知識:
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       為了保證培訓效果,增加互動環節,我們堅持小班授課,每期報名人數限3到5人,多余人員安排到下一期進行。
   上課時間和地點
上課地點:【上海】:同濟大學(滬西)/新城金郡商務樓(11號線白銀路站) 【深圳分部】:電影大廈(地鐵一號線大劇院站)/深圳大學成教院 【北京分部】:北京中山/福鑫大樓 【南京分部】:金港大廈(和燕路) 【武漢分部】:佳源大廈(高新二路) 【成都分部】:領館區1號(中和大道) 【沈陽分部】:沈陽理工大學/六宅臻品 【鄭州分部】:鄭州大學/錦華大廈 【石家莊分部】:河北科技大學/瑞景大廈 【廣州分部】:廣糧大廈 【西安分部】:協同大廈
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先進IC設計班:2025年4月7日............................
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     ☆資深工程師授課

        ◆外地學員:代理安排食宿(需提前預定)
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        ☆合格學員免費推薦工作

        

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        1、培訓過程中,如有部分內容理解不透或消化不好,可免費在以后培訓班中重聽;
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          先進IC設計技術培訓班

技術亮點:

個人消費電子和無線產品已經成為當今世界電子市場的主導力量。這些設備對于新功能和特性的無止境的要求促進了混合信號應用設備的前所未有的發展。隨著復雜性正不斷提高,工程師需要應對緊迫的上市時間和對良品率敏感的納米設計。企業也必須在有限的預算和工程師數量下克服所有這些障礙。實現團隊需要一種全新的方法,以解決在高工藝節點下與高產量、高性能SoC設計相關的各種問題。當今的大型芯片通常還混合了模擬和數字電路,要成為高效率的設計師,就要有在相同環境中解決兩種設計任務類型的能力。 Cadence的AMS混合信號電路設計解決方案為全球工程師提供了AMS設計的佳平臺。

Cadence Encounter 數字IC設計平臺提供了納米級SoC設計所需的全方位的技術,幫助邏輯設計和物理實現團隊快速完成高質量的芯片。 而Cadence Incisive 平臺提供了快有效的方式檢驗大型復雜芯片。它確保你的產品符合規范,消除了開發過程中的生產力、可預測性和質量風險,從而能夠及時推出沒有缺陷的產品。

 

要點:

1、Semiconductor Market Overview (半導體市場發展趨勢)
2、Cadence Technology Update (Cadence新技術)
3、專題一:Verification/Digital IC Solutions(驗證、數字IC解決方案)
專題二:A/MS Design Solution (模擬和混合信號設計解決方案)

專題一涉及的技術內容:

1. Verification update-- Felix Cha

2. Low Power Techniques Introduction

3. Cadence Low Power Solution overview

4. Common Power Format

5. Low Power Architecture Design with InCyte Chip Estimator (ICE)

6. Low Power Verification with Incisive Enterprise Simulation (IES)

7. Low Power Logic Synthesis with Encounter RTL Compiler (RC)

8. Low Power Physical Implementation with Encounter Design Implementation System (EDI)

9. Low Power Verification with Encounter Conformal Low Power (CLP)

10. Technical Discussion

專題二涉及的技術內容:

1: Mixed-Signal Design overview

2: Cadence Mixed-Signal Design solution

3: Analog and Mixed-Signal design Environment

4: SPICE Simulation and Turbo Technology

5: Mixed-Signal Simulation Methodology

6: Full-Chip transistor level Verification

7: Fast Physical Layout implementation

8: Accuracy and powerful Physical Verification

9: Parasitic Extraction and Back-annotation technology

10:Technical Discussion

 
 

 

 
 
 
 

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.(2012年12月17日........,,,...........................................)...............................................................
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